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Sdram_Control_4Port.rar
多端口SDRAM控制器RTL级(verilog)代码,采用异步时钟,适用于各种SDRAM芯片,可以根据实际需求以及sdram带宽进行多端口的添加来实现多个模块间的数据交互。
2020-07-07
cordic_atan.zip
verilog语言实现利用cordic算法流水线计算正切值,即角度,可以利用在求如hog特征中求梯度方向。文件包含RTL级代码以及testbench文件,支持modelsim仿真。
2020-07-06
空空如也
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