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RSS订阅原创 Vivado System Generator for DSP - “Error evaluating ‘OpenFcn‘ callback of Xilinx Block“错误解决方法
使用Vivado System Generator for DSP时，遇到"Error evaluating 'OpenFcn' callback of Xilinx Block"报错，
2022-09-14 10:05:12
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原创 [VRFC 10-529]concurrent assignment to a non-net fir_out_data is not permitted.
问题原因：例化模块时，模块的输出信号设为reg.解决方法：将模块输出信号改为wire.
2021-08-24 15:55:42
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原创 [XSIM 43-3225]Cannot find tb design unit work. in library work located at xsim.dir /work解决
进行Vivado 仿真时出现报错xsim[43-3225] Cannot find tb design unit work. in library work located at xsim.dir /work，解决方法如下：检查tb选项中的hierarchy update mode，是否为Automatic Update, Manual Compile Order,若是，重新设置后refresh. 移除并重新添加tb文件。 代码有语法问题。来源：AR# 56685: 2013.1 Vivado S
2021-08-24 15:37:29
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原创 visualDSP错误
1. visualDSP*** No rule to make target E:/wo/chenlijun/echo_re.dat', needed byDebug/bigmain.doj’. Stop. visualDSP运行project出现上述错误时，可能是因为没有更新依赖文件，在project->Update Dependencies即可。
2017-11-16 10:40:15
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2017-11-16 10:35:10
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空空如也
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