郭天祥 TC35I模块介绍
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电源芯片LM2941
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郭天祥GSM模块原理图
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郭天祥GSM模块使用说明书V1.1
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郭天祥C语言字符串函数功能简介
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郭天祥AT命令手册(中文).pdf
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2008全国大学生数学建模大赛试题
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基于ARM+FPGA的运动控制器设计与实现
本文以微控制器AT91RM9200和EP1C6Q240C8为核心,对工业CT机的运动控制器进行了设计,从硬件和软件两个方面对控制器的关键技术进行研究与设计,应用单神经元自适应PID控制算法进行仿真,并给出系统实际运行结果。
基于ARM和FPGA的电力光纤信号分析仪的设计
为了能更好地实现变电站的自动化和数字化以及完成变电站系统的实时监控、测试,更快捷、直观地获得设备的运行状态。介绍了一台基于ARM+FPGA的电力光纤信号分析仪的设计与研究,从硬件方面提出了新的设计方案。这种光纤信号分析仪主要实现对数字化变电站中通过100 M BaseFX传输的各种格式报文的抓取、信息提取、报文解码、实时存储及波形显示等功能。
基于ARM+FPGA的1394总线在TFT-LCD检测系统中的应用
介绍了IEEE1394总线在TFT-LCD检测系统中的应用,通过IEEE1394总线实现TFT-LCD 检测系统的光斑数据采集以及图像采集板和Z轴控制器之间的通信.给出了1394通信模块的软硬件设计.
基于ARM和FPGA的便携人工地震数据采集系统设计
介绍了一种基于Atmel AT9lSAM9G20(ARM926EJ-S核)低功耗微处理器和Actel AGL600 (低功耗Flash-based FPGA)并融合嵌入式Linux技术的便携式人工地震数据采集系统的设计原理和实现方法.该设计引入动态电源管理技术,根据系统负载自动进行微处理器工作频率调节和外围I/O设备的工作模式调整.本数据采集系统功耗低、体积小,野外使用安装便捷,对降低数据采集成本、延长系统有效工作时间、提高野外工作效率有着积极意义.
基于ARM及FPGA实现的嵌入式触摸屏任意信号发生器
以FPGA/Cyclone II-EP2C8Q208芯片为核心,采用12 bit AD7920作为DAC,由带触摸屏的256色5.7英寸CSTN彩色液晶屏、快捷键等组成人机交互界面的硬件平台,Delphi7.0与USB1.1完成上位机图形操作界面通信,在ARM/S3C44B0X的控制下,实现基于DDS的单通道便携式任意信号发生器。除了可产生±10 V/0.01 Hz~30 MHz的正弦波等常规波形外,还能输出数码流、调制信号、随机噪声、扫频信号等,特别是时域或频域的自定义波形,而且信号参数均是步进在线可调。实验表明该设计有效,在介绍系统设计思想的同时,还重点讲述系统FPGA与软件以及自定义波形设计等。
基于ARM+FPGA的大屏幕显示器控制系统设计
目前各种LED显示器常采用8位/16位的微处理器,由于其运行速度、寻址能力和功耗等问题,已难满足显示区域较大、显示内容切换频繁的相对较复杂的应用场合。采用32位ARM嵌入式微处理器S3C4510B和32位FPGA扫描驱动电路芯片PolarPro QL1P300,选用IS61C1024静态RAM作为缓存器,组成由多块大屏幕LED显示器构成了新的显示系统。该系统在不增加成本的情况下,可支持更大可视区域的稳定显示,存储更多显示内容。
基于ARM+FPGA的GPS接收机设计
针对GPS接收机在民用和军事领域的重要应用,设计了一种基于ARM+FPGA的GPS接收机。接收机的射频前端采用GP2015芯片,基带处理部分采用ARM9内核的AT91SAM9261芯片和Cyclone II系列的EP2C70F672I8芯片。同时阐述来接收机的软件设计,包括捕获引擎、跟踪引擎、解调电文,定位解算等。该接收机通过现场实验定位精度为6m(经度)/8m(纬度),动态性能达2000m/s,可以实现高动态导航定位,同时体积小,功耗低。 更多还原
基于ARM SoC的FPGA原型验证
ARM是目前SoC设计中应用最为广泛的高性价比的R ISC处理器,FPGA原型验证是SoC有效的验证途径,FPGA原型验证平台能以实时的方式进行软硬件协同验证,从而可以缩短SoC的开发周期,提高验证工作的可靠性,降低SoC系统的开发成本。
采用ARM & FPGA的真空断路器控制系统
选相投切技术能有效地抑制涌流和过电压等暂态过程,已在不同领域获得越来越广泛的应用。采用ARM+FPGA的结构制作的选相开关控制器,具有更强的功能,更高的计算效率和升级空间,更加适合于智能化变电站的需要。 更多还原
基于FPGA和ARM的现场总线设备
根据现场总线的特点,提出一种基于现场可编程逻辑门阵列(FPGA)和高级精简指令集机器(ARM)的现场总线设备设计框架。FPGA负责完成协议栈链路下层逻辑和物理线路控制逻辑,该部分功能有严格的时延限制,ARM负责完成协议栈链路上层逻辑和网络层以上所有层逻辑,该部分功能有稍微宽松的时延限制。实验结果表明,该设计框架能够满足通信、互联和实时性要求。
基于ARM和FPGA数控信号发生器的设计
本设计以ARM为核心,控制FPGA实现直接数字频率合成功能。FPGA内部的地址累加器作为相位数据,以查表方式得到幅度数据,通过高速D/A转换器和高速运放得到所需输出信号波形。输出信号的幅度调节则由模拟开关控制电阻网路实现。系统采用串行键盘进行参数设置,由LCD实时显示输出波形及设置信息。FPGA基准时钟采用51.2MHz有源晶振,通过FPGA内部锁相环,为系统提供140.8MHz的高频时钟信号。
基于FPGA的64点FFT处理器设计
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基于FPGA的高性能32位浮点FFT+IP核的开发
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verilog编写的1024点的fft快速傅立叶变换代码
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网络流量监控软件NetSpeedMonitor
安装方法:
1、根据你的系统版本,复制相应的文件夹至任意目录
2、双击“安装.bat”安装
3、在弹出的对话框中分别单击“确定”、“是”。
4、安装完成,右键任务栏新出现的区域,请单击右键菜单中设置——应用程序设置——语言中的English改为Deutsch。(否则会导致任务栏+开始菜单的邮件菜单都变成英文)
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