- 博客(0)
- 资源 (2)
空空如也
VHDL 8位乘法器设计
完整的实验报告 由8位加法器构成的以时序逻辑方式设计的8位乘法器。其乘法原理是:乘法通过逐项位移相加原理来实现,以被乘数的最低位开始,若为1,则乘数左移后与上一次和相加,若为0,左移后以全零相加,直至被乘数的最高位。
2012-06-24
电子大赛历届题目方案分析及讲解
电子大赛历届题目方案分析及讲解电子大赛历届题目方案分析及讲解电子大赛历届题目方案分析及讲解电子大赛历届题目方案分析及讲解电子大赛历届题目方案分析及讲解
2011-09-12
空空如也
TA创建的收藏夹 TA关注的收藏夹
TA关注的人