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空空如也

CRC-32并行32bit实现

本文是基于CRC-32串行电路基础上改进的CRC-32并行实现,采取32bit并行输入的verilog实现

2012-07-30

基于FPGA三速以太网的实现(UDP通信)

本代码是基于Altera Arria ii ep2agx65芯片实现的100M/1000M网代码,主要完成fpga向PC的UDP发送实现(verilog)

2012-06-25

BCH中钱搜索模块实现(纠错t=24)

本代码是基于verilog实现的钱搜索模块,可以纠错24bit,是BCH中的第三个关键步骤的实现,其中包括14位伽罗华域乘法器的实现

2012-06-25

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2012-02-09

基于fpga实现I2C协议的verilog模块以及测试代码

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2011-09-26

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比较好的电路后端设计资料,比较好的PCB制版,希望大家可以学习一下,比较好的资料,

2011-09-16

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