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RSS订阅原创 Veriloga实现十进制转二进制8bit数
Veriloga实现十进制转二进制8bit数，可以根据需要改成4bit, 10bit等。用在模数混合仿真里面。
2022-11-20 22:07:14
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原创 在windows下设置共享文件夹给虚拟机里面的linux系统
进入你的虚拟机中，然后，右击你的虚拟机的标签，选择设置-->options选项卡中有一个逗共享文件夹地用鼠标选中它，再在右边窗口中，点添加按钮，再在你的linux系统中作如下操作：cd /mnt/hgfs/<你的共享名>在这里面你就可以看到你的真实主机中的东西了。还有一个前提：就是你在你的虚拟机上一定要安装好vmware tools工具包。才可以...
2020-10-02 22:36:35
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Analog and Mixed-Signal Circuits in Nanoscale CMOS
The Analog Circuits and Signal Processing book series, formerly known as the
Kluwer International Series in Engineering and Computer Science, is a high level
academic and professional series publishing research on the design and applications
of analog integrated circuits and signal processing circuits and systems.
2023-03-05
AI at the Edge
这是一本介绍AI的书，如有侵权请通知我下架
Over the past few years, a growing community of engineers and researchers have quietly
rewritten the rules for how computers interact with the physical world. The result, a technology
known as “edge artificial intelligence,” promises to upend a century of computer history and
touch the lives of every human being.
With a tiny software update, edge AI technology can grant cheap, energy-efficient processors—
already inside everything from dishwashers to thermostats
2023-03-05
用7段共阳数码管做的时钟 verilog程序
用7段共阳数码管做的时钟 verilog程序
// 时钟用4个数码管显示，显示秒和分，修改一下可以加上时或跑秒
// sys_clk为系统时钟：50MHz
// seg_dat为输出给数码管的8个1bit信号
// seg_sl 为数码管位选通
2013-12-04
用7段共阳数码管显示任意一个4位数的verilog程序
用7段共阳数码管显示任意一个4位数的verilog程序，如果你的数码管是共阴极，你知道怎么改。另外，把要显示的数N改成输入，就可以加到其他模块里面去被调用了。
2013-12-04
LPC21xx系列用于keil MDK的启动文件
用于keil mdk开发lpc系列ARM7 的启动文件，解压后全部复制到工程文件夹中，打开keil mdk后添加到工程target中。直接打开main即可编辑代码。
2013-02-28
空空如也
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